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Autor(es): Maidana, Carlos Eduardo
Gho, Edgardo Alberto
Hnatiuk, Jair Ezequiel
Rodríguez, Carlos Alberto
Fiter, Jorge Antonio
Título: Implementación de la expansión de un procesador RISC-Vp en un entorno de desarrollo de lógica programable
Director(es): Maidana, Carlos Eduardo
Descriptores y temas: SOPORTE LOGICO
ANALISIS DE DATOS
LENGUAJES DE PROGRAMACION
MODELADO DE DATOS
Editor: Universidad Nacional de La Matanza. Departamento de Ingeniería e Investigaciones Tecnológicas
Referencia sugerida: Maidana. C. E., Gho, G. A., Hnatiuk, J. E., Rodríguez, C. A., Fiter, J. A. (2022). Implementación de la expansión de un procesador RISC-Vp en un entorno de desarrollo de lógica programable (Informe C2-ING-082). Universidad Nacional de La Matanza. http://repositoriocyt.unlam.edu.ar/handle/123456789/2019
Resumen y filiaciones: El presente proyecto tomó como base el conocimiento obtenido al diseñar RISC-Vp (VHDL), ya que este se pudo reimplementar como RISC-V2p (Verilog). Esta nueva versión tiene significativas mejoras, debido a que todas las instrucciones se resuelven en un tiempo fijo de cuatro ciclos. Esto deja abierta la posibilidad de implementar técnicas de pipelining sobre el mismo de ser necesario. El diseño no solo puede ser simulado con herramientas de lógica programable, como era el caso de RISC-Vp (VHDL), sino que puede ejecutarse sobre silicio. Los ensayos se realizaron sobre el kit de desarrollo Digilent ARTY A7-35.
Fil: Maidana, Carlos Eduardo. Universidad Nacional de La Matanza; Argentina.
Fil: Gho, Edgardo Alberto. Universidad Nacional de La Matanza; Argentina.
Fil: Hnatiuk, Jair Ezequiel. Universidad Nacional de La Matanza; Argentina.
Fil: Rodríguez, Carlos Alberto. Universidad Nacional de La Matanza; Argentina.
Fil: Fiter, Jorge Antonio. Universidad Nacional de La Matanza; Argentina.
URI: http://repositoriocyt.unlam.edu.ar/handle/123456789/2019
Aparece en las colecciones: Investigaciones



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